• Гідрологія і Гідрометрія
• Господарське право
• Економіка будівництва
• Економіка природокористування
• Економічна теорія
• Земельне право
• Історія України
• Кримінально виконавче право
• Медична радіологія
• Методи аналізу
• Міжнародне приватне право
• Міжнародний маркетинг
• Основи екології
• Предмет Політологія
• Соціальне страхування
• Технічні засоби організації дорожнього руху
• Товарознавство продовольчих товарів

Single Cycle Timing

1. (Start of cycle) Instruction retrieved into instruction register.

2 (PC contents updated.)

3. Instruction decoded and registers accessed.

4. Register contents gated onto ALU input bus (immediate operands sign-extended and input to ALU).

5. ALU function identified and ALU result obtained.

6. ALU results used to access memory location if required.

7. Memory data written (store) or retrieved (load) if memory access instruction.

8. Data gated onto register input bus.

9. (End of cycle) Instruction result stored in designated register if required.

Fig. 3.13 Single Cycle Timing Architecture

Читайте також:

1. The Single Channel Ground and Airborne Radio System
2. The “Single Cycle” ALU

Переглядів: 604